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FPGA如何锁定三个异步时钟(时钟频率相同)的相位关系吗?

如何锁定三个异步时钟(时钟频率相同)的相位关系吗?

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外部输入的吗,内部PLL产生的倒不用担心了

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评论

外部输入的三个同频率的异步时钟

ipqsn 头像ipqsn ( 2018-01-22 10:16:28 +0800 )编辑
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