3.1I COREGEN核心生成器VHDL和Verilog行为模型库的分析/编译顺序

描述


CIPIP2,CIPIP3,CIPIP4,CYIP5



紧迫:热



一般描述:

VHDL行为模型之间存在明确的层次关系。

科雷根交货。这必须被考虑,以便不需要编译它们。

准备前的错误,在仿真之前。对于VHDL,必须编译层次结构。

自下而上(即“原始”)模型必须被编译或分析。

“实例化”模型中的“宏”模型。



对于Verilog,编译顺序不是关键的,而是使用推荐的

编译命令将最小化编译期间发出的警告数量。

过程。

解决方案


2.1i VHDL:



在CYIP2版本中发送的模型所需的顺序是:



原始常数

PrimssCopys*VHD

原发性紫癜

初弓

乌尔苏

*PAC.VHD

CV*COV.VHD

VHD

CV*VHD

*VHD



列表中的最后一项将导致某些模型被重新编译,但

这不是一个问题——没有关于MODESIM的错误

重新编译模型。唯一的要求是任何低级模型。

需要在更高级别的模型之前编译。



上面所要求的顺序可能会随着每次IP更新而略微改变。

Xilinx船舶,但关于编译命令要求的更新信息

将包含每个更新,以及该解决方案记录。



2.1I,CYIP3:



在CYIP3版本中所需的VHDL模型的顺序是:



原始常数

PrimssCopys*VHD

原发性紫癜

初弓

乌尔苏

*PAC.VHD

CV*COV.VHD

VHD

C.AddiSub V1Y0.VHD

CuMuxBuxV10.0.VHD

CV*VHD

*VHD



在CYIP3中编译Xilin XCordilb Verilog文库的推荐顺序是:



C*ReGuffDV1V0.0V

C.AddiSudi.v

*V



2.1I,CIPIP4:



对于CIPIP4发布,必须确保VHDL UNISIM库被编译

首先,在VHDL XILIXXCORILB库之前。



UNISIM库位于Xilinx/VHDL/SRC中。你需要编译

下列文件:



单程VHDKVG.VHD

UNISIMIMVCOV.VHD

一种VHD

UNISIMIVVCFG4K.VHD





用于编译MODESIM的UNISIM库的示例命令如下:



VCOM - 87 -工作UNISIM $ Xilinx/VHDL/SRC/UNISIMS/UNISIMIVVPK.VHD

VCOM - 87 -工作UNISIM $ Xilinx/VHDL/SRC/UNISIMS/UNISIMIVVCOV.VHD

VCOM - 87 -工作UNISIM $ Xilinx/VHDL/SRC/UNISIMS/UNISIMU-VITAL.VHD

VCOM - 87 -工作UNISIM $ Xilinx/VHDL/SRC/UNISIMS/UNISIMIVCFG4K.VHD



------------------------------

西林克雷利布编纂

------------------------------



编译XILN XCORILB库时,VHDL模型所需的顺序

在CIPIP4中发布的内容是:



(注意:一定要包括“*”符号。)



原始常数

PrimssCopys*VHD

原发性紫癜

初弓

乌尔苏

*PAC.VHD

CV*COV.VHD

VHD

C.AddiSudi.VHD

CH MuxBuxB** VHD

CV*VHD

VFTTH

*VHD



如果仿真器需要单独或不编译每个模型

允许您不止一次重新编译同一个模型,您可以使用此模型

秩序:



PrimsSistangsV1Y0.VHD

普罗旺斯

PrimsSmith-V1L0.VHD

普鲁士公司

樱草属

普氏菌V1Y0.VHD

初筛

SimsiSmithCARCHV1Y0.VHD

乌尔苏

VFTTH

VFFT1024.VHD

VFFT1024Y-COV.VHD

VFT16.VHD

VFT1616COV.VHD

VFFT256VHD

VFFT256Y-COV.VHD

VFFT64.VHD

VFFT64

马尔科夫

MulvtHyv.VHD

Acc2SvHT.VHD

ACC2VSHTA

AdvSv.VHD

AdvStHypC.VHD

阿德雷夫特

阿德雷夫特公司

超高压直流电动机

阿德莱维特公司

CMPVHTH.VHD

CMPVSHTH.COMP.VHD

MUX2VHT.VHD

MUX2VHTYCOV.VHD

MUX3VHT.VHD

MUX3VHTYCOV.VHD

MUX4VH.VHD

MUX4VHTYCOV.VHD

超高速直流电动机

PSCVHTL公司

RVCH

雷切夫特公司

马歇尔

马赛克

超高压直流电动机

SuffReftHyf.VHD

超高压直流电动机

苏布列夫公司

TSB16VHTH.VHD

TSB16SvHTYCOMP.VHD

TSB16XVHT.VHD

TSB16XVHT-COMP.VHD

TSB32 xVHT.VHD

TSB32 xVHT-COMP.VHD

平方英尺

SqrotvtHypV.VHD

TrimaTLLV1V0.VHD

TrimaTLL1V1O0*COV.VHD

除法除颤器

分频器

SDHF

斯达夫公司

血小板活化因子

PDF

NCOVIV1Y0.VHD

NCOIQUIV1Y0.VHD

CY-ReqFdV1V0.0.VHD

C.ReGuff-V1V1O0*COV.VHD

MultyVGNYV1V0.VHD

MultyVGNYV1O00COV.VHD

DPRAMVHT.VHD

普拉姆维特公司

罗姆华

罗姆维特公司

同步加速器

同步加速器VHD

KDCMYV1Y0.VHD

KDCMV1V1O0*COV.VHD

KCMVHT.VHD

KCMVHTL公司

KCMPIPEVHTVHD

KCMPIPEVHTL公司

超高压直流电动机

集成电路VHD

M12X12VHD

M12X12Co VHD

M8x8VHD

M8X8Y-COV.VHD

先进技术

先进技术

无刷直流电动机

德莱维特公司

超高压直流电动机

康普菲特VHD公司

MeMyNi公司

CyMyMydpB1-V1L0.VHD

CyMeMySp1

CyMeMySp1嵌段V1Y0.VHD

C.AddiSub V1Y0.VHD

C.AddiSub V1Y00COV.VHD

Cy-聚氧乙烯1V0.VHD

CyApple

CXCOMPARIEVIV1V0.VHD

CYCOMPARIEV1V00COV.VHD

CuMuxBuxV10.0.VHD

CuMuxBuxV1O00COV.VHD

C2对二值V1Y0.VHD

CX-DEDELIN BIALARYA V1Y00COMP.VHD

CX-DEDELY-BiARYVA V1Y0.VHD

C.Guang-BITBuxV1Y00COV.VHD

CVistouMyV1V0.VHD

C.GATEGATION BITBUSEV1Y0.VHD

CuMuxSLICIX BuffiV1000COV.VHD

C.GATEGATION BITVIV1Y0.VHD

C.Guang-BuxV10.0.VHD

CuMuxBiTi V1Y0.VHD

CuMuxSLIX BuffiV10.0.VHD

CuMuxSLICE-BuftV1V100COV.VHD

CuMuxSLICE-BuftV1V0.VHD

CyReGuLDLDV1Y0.VHD

CY-ReqLLDV1V0Y0COV.VHD

CuMuxBITIV1V0Y0COV.VHD

CfSHIFT-FDV1V0.VHD

CVSHIFT-FDYV1O0*COV.VHD

CVSHITETA RAMIV1V0.0.VHD

CVSHITETA RAMIVA V1Y00COV.VHD

C~(2)

CX-THOXSCOMPUVIV1O0*COV.VHD

管道系统

CVDI

CyMeMydpB1

反恐精英

C.Guang-BuxV1Y00COV.VHD

C.GATEGATION BITVIV1Y00COV.VHD

异步电动机

AsiccFIFOVIV1Y0.VHD

异步电路



在CYIP4中编译Xilin XCordilb Verilog文库的推荐顺序是:



C*ReGuffDV1V0.0V

C.AddiSudi.v

*V



如果仿真器需要单独编译模型,则可以使用此模型。

秩序:



CyApple

C.AddiSub v1y0.v

CyCOMPARIEV1V1.0V

CyAuthBialayV11.0V

C.DaaFiRuxV2Z0.V

CX-DEDELIN

C.DistaMyMyV10.0V

C.GATEGATION BITBUSSIV1O0.V

C.GATEGATION BITV1V1O0.V

C.Guang-BuxV10.0V

CyMyMydpB1

CyMeMySp1

CuMuxBiTyV1V0.0V

CuMuxBuxV1O0.0

CuMuxSLICIX BuffiV10.0V

C.MuxSLICIO-BuftV1V1.0V

C*ReGuffDV1V0.0V

C*ReqLLDV1O0.V

CVSHIFT-FDF1V0.0V

CVSHITETA RAMIV1V0 ...
(更多...)
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提问于 2018-07-29 19:17:32 +0800

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