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LATTICE FPGA ECP5 调SDI时 serdes输出的时钟一直锁存不住怎么办?

有大佬调过走serdes的sdi么,咋serdis输出的时钟一直锁存不住?

我现在是sdi的720P能显示(不过少啦两行和十五列),但是通过逻辑分析仪抓波形看是serdes传出来就是这样的,1080P就锁不住时钟

serdes传出来的时钟应该是没有锁定,就一直在SD,HD,和3G这三个分辨率跳来跳去

现在问题可能是复位和参考时钟,但是复位我按照demo来也是一样,然后自己试了别的还是一样

都用一个复位处理啦,

LATTICE FPGA ECP5 调SDI时 serdes输出的时钟一直锁存不住怎么办?

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BertramChen 头像
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先测试一下环回有没问题,如果自环都有问题,那应该就是电源的原因了。

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wanakaka 头像
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没有相关设备, 很难调好的,我做mipi时钟跑到480MHZ就是调起来比较费事,

你看看我量的眼图,这样就比较容易调,还是上高速示波器什么的吧。

SDI SERDERS 调试设备

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ganh 头像

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是的,就是只有一个hmdi转sdi的盒子,而且我看图像都像是缩放的,现在也没器材给我看sdi输出到底是啥图像

yinhk 头像yinhk ( 2017-12-09 09:22:44 +0800 )编辑

@yinhk 要求不高随便做吧, 如果要按照广电要求就不能马虎了, 1080P要达到2.97G串行速率

pipisan 头像pipisan ( 2017-12-09 09:23:35 +0800 )编辑
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pll输出的时钟达不到要求吧, 眼图抖动大, 记得标准要低于0.10UI. 即100k.

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fuckfpga 头像

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现在在让硬件那边调参考时钟

yinhk 头像yinhk ( 2017-12-09 09:01:28 +0800 )编辑

是的 时钟可能达不到要求,但是 不至于 到他的那个地步

pipisan 头像pipisan ( 2017-12-09 09:02:39 +0800 )编辑
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分高速模块和低速模块,优先调好了高速模块后将其lock住

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回答 2017-12-09 09:25:22 +0800

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我现在就一个serdes和sdi的ip核和一个解rgb和一个显示模块, 硬件说参考时钟调只能调到150M左右,这样是不是不行啦

yinhk 头像yinhk ( 2017-12-09 09:25:39 +0800 )编辑

@yinhk 够了:  dclk refclk sd: 27M 67.5M hd: 74.25M 74.25M 3g: 148.5M 148.5M

popomao 头像popomao ( 2017-12-09 09:27:29 +0800 )编辑
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加均衡增益EQ了没?均衡增益, 148.5M要确保时钟质量

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inner 头像

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我这个是由于硬件那边吧参考时钟不知道咋调调成啦67M,所以目前使用pll生成的148.5M的内部参考时钟

yinhk 头像yinhk ( 2017-12-09 08:40:13 +0800 )编辑

67.5M是用于标清分辨率

inner 头像inner ( 2017-12-09 08:40:31 +0800 )编辑
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先检查硬件设计,时钟,电源,阻抗等等,然后结合后面的TRI_RATE_SDI IP一起来调试

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shawn 头像
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结合TRI_RATE_SDI IP啦,然后图像显示发现啦问题,然后排查到了serdes这边有问题

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yinhk 头像
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你强制锁定,不要太快跳

lattice的技术支持说的。

有一个3bit 的输入可以设置的,先调 3g 的

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pipisan 头像

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现在是设置成HD和3G 目前就720P能出,不过有问题,单独设置成3G的话就锁不住时钟

yinhk 头像yinhk ( 2017-12-09 08:56:23 +0800 )编辑

@yinhk 那就是复位问题,如果不知道咋改,找个DEMO原理图看看。

pipisan 头像pipisan ( 2017-12-09 08:56:50 +0800 )编辑
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