0

XILINX FPGA ila timing loop错误

板子的分模块，再加上ila检测程序时，就显示timing loop.把ila程序注释掉，程序就正常

编辑 重设标签(回车键确认) 标为违禁 关闭 合并 删除
fzw 头像
添加评论

1 回答

排序依据» 按最早加入 最新问题 最有价值的问题
0

那说明路径中有的逻辑循环，这个是要完全消除的。

编辑 标为违禁 删除 链接 更多选项...
shawn 头像

评论

但是我在schematic中并没有发现电路中有循环，请问像这样的问题正常从哪方面去入手查找问题根本

fzw 头像fzw ( 2022-02-21 13:09:20 +0800 )编辑

常规思路，逐个按模块去查，

popomao 头像popomao ( 2022-02-22 13:27:37 +0800 )编辑
添加评论
登录/注册后进行回答
注册
登录

提问工具

1 follower

订阅RSS

统计

已提问: 2022-02-17 17:57:01 +0800

已查看: 38 次

最后更新: Feb 19

相似的问题

aurora链路不通