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想问下大家在使用Xilinx A7系列的FPGA来开发SoC时,自己写的IP模块,是如何挂接到总线的Dummy上的?

Snipaste_2020-08-16_15-09-23.jpg

像这个预留的dummy模块,如果一开始提供的信号参数列表和自己设计的IP信号参数列表不同,不知道要怎么改?

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还没搞过ZYNQ,帮顶!!!

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