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请教给位大佬，怎么实现两个数据信号的优先级控制

本人是新手，最近在和老师做一个有关FPGA的项目，用的是正点原子的板子,Quartus||的开发环境，目前遇到困难，就是有两个信号uart_en_1和uart_en_2，两个信号基本同时发出，想实现让模块先响应uart_en_1后，再响应uart_en_2。

FPGA小白
1 ●1 ●1

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4 回答

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自己寫仲裁很簡單
兩個同時到就用輪流方式 A B A B
沒人搶先到先做

老陳
1 ●2 ●2

优先级控制可以直接使用if else，
if（uart_en_1）begin
end
else if（uart_en_2）begin
end

三尽
1

if else就可以了吧

52fpga
21 ●17 ●36 ●66

看看RTL综合工具的描述就知道了。

shawn
352 ●30 ●65 ●98

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已提问: 2019-09-12 22:22:48 +0800

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最后更新: Dec 17 '20

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