如何从PCLK引脚路由DLL输入并具有一致的小延迟?

除专用PLL输入外,LatticeSC / M边沿时钟资源的延迟最小。在该时钟网上添加“USE EDGE”首选项。。这给出了将输入时钟信号沿ECLK路由到DLL中的一致时序。
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提问于 2018-07-27 10:54:59 +0800

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