用于PCI的LogiCORE Initiator / Target v4.8 - 实现XC5vLX110t-FF1136可能会导致PAR错误:“错误:布线:472 - 此设计无法布线。”

问题描述

已知问题v4.8

在11.1中为XC5vLX110t-FF1136实现66 MHz设计时,它可能会在PAR期间出现此错误:

“错误:布线:472 - 这种设计无法实现。

要评估此问题,请使用fpga_editor。

布线冲突1:网络:位于SLICE_X5Y95上的DX引脚上的M_CBE <7>

净:XPCI_WRAP / TRDYI_78_ML_BYPASS在B4针脚上的位置SLICE_X4Y96

在线上检测到冲突:PINBOUNCE(-121639,51016)“

解决/修复方法

要解决此问题,请将以下约束添加到UCF文件:

INST“XPCI_WRAP / XPCI_CORE / BU2 / U0 / pci64_inst / PCI_LC_I / MASTER / IRDY /

M_FIRSTIN2“XBLKNM = XLNX_WA1;

INST“XPCI_WRAP / XPCI_CORE / BU2 / U0 / pci64_inst / PCI_LC_I / MASTER / IRDY /

M_FIRST“XBLKNM = XLNX_WA1;

INST“XPCI_WRAP / XPCI_CORE / BU2 / U0 / pci64_inst / PCI_LC_I / MASTER / IRDY /

M_FIRSTIN1“XBLKNM = XLNX_WA1;

INST“XPCI_WRAP / XPCI_CORE / BU2 / U0 / pci64_inst / PCI_LC_I / MASTER / REQ64

/ NS_REQ64_28“XBLKNM = XLNX_WA1;

INST“XPCI_WRAP / XPCI_CORE / BU2 / U0 / pci64_inst / PCI_LC_I / MASTER / REQ64

/ NS_REQ64_52“XBLKNM = XLNX_WA1;

修订记录

04/13/2008 - 初始版本

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提问于 2018-08-18 20:01:53 +0800

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