QuartusTM软件中是否存在仿真锁相环(PLL)LOCK引脚的问题?

是。在Quartus Simulator中,如果PLL锁定后时钟停止翻转, LOCK引脚将保持高电平。 LOCK引脚应为低电平,以正确演示器件的行为。

这被固定在Quartus®II软件2.0版。

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提问于 2018-08-06 16:52:50 +0800

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