为什么我在设计中看到Altera POS-PHY Level 4 MegaCore中的恢复时序违规?

由于Altera®POS -PHY Level 4(接收器)MegaCore®的自动生成的synopsys设计约束(.sdc)文件存在问题,您可能会在"*dpa_align:dpa_align|dpa_reset""*altlvds_rx_component|*auto_generated|rx*bit_slip_reg" "*dpa_align:dpa_align|dpa_reset"路径上看到恢复时序违规"*altlvds_rx_component|*auto_generated|rx*bit_slip_reg"

这是由于以下自动生成的.sdc分配被忽略:

set_multicycle_path -setup -end -from "*dpa_align:dpa_align|dpa_reset" -to "*altlvds_rx_component|*auto_generated|rx[*]~bit_slip_reg" 2
set_multicycle_path -hold -end -from "*dpa_align:dpa_align|dpa_reset" -to "*altlvds_rx_component|*auto_generated|rx[*]~bit_slip_reg" 1

要解决此问题,您可以使用以下分配替换上面的分配(可以在自动生成的.sdc文件中找到):

set_multicycle_path -setup -end -from [get_keepers {*dpa_align:dpa_align|dpa_reset}] -to [get_keepers {*altlvds_rx_component|*auto_generated|rx*~bit_slip_reg}] 2
set_multicycle_path -hold -end -from [get_keepers {*dpa_align:dpa_align|dpa_reset}] -to [get_keepers {*altlvds_rx_component|*auto_generated|rx*~bit_slip_reg}] 1

计划在Altera完整设计套件的未来版本中解决此问题。

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提问于 2018-08-04 14:33:26 +0800

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