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安装modelsim提示版本不兼容

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请教一下，ise调用modelsim后的这个默认仿真时间100ps怎么修改

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请教quartus II自定义IP能否实现参数设置？

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altera FPGA DDR2的 dqs_int_delay_in<0> 的时序，怎么调整？

匿名

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请教ZYNQ的7020跑linux如何注册0-15中断？

匿名

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MB调试iic时，用chipscope抓取iic inout信号出现问题请教

匿名

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哪位大神有linux版本的modelsim,能发个网盘连接

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"Error (176060): The transmitter driving I/O pin"错误是怎么回事？

匿名

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quarteus无法识别USB Blaster怎么办？

匿名

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各位大神，请问sram一开始写入数据，那之后读的地址一定是写入的数据地址吗？ [已关闭]

匿名

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请问有没有大佬有MIPI DSI TX 的驱动啊？使用xilinx IP的

匿名

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LM97937 204b通讯数据解析出错请教

匿名

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请问一下，fpga的嵌入式存储器容量对应CPLD的哪个参数啊?

匿名

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请问大家有 vivado 2016.4 的破解文件吗？

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请问你的vivado2016.4使用的modelsim是哪个版本？

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请教大牛一个问题， Cyclone系列的fpga 功耗最大会达到多少呢? [已关闭]

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有没有遇到lattice diamond报“Error 1 in prepareBelPlace”错误？

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lattice diamond安装报错“license checkout failed”

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LATTICE FPGA管脚绑定出现port总是被Unconnected的问题

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分享一下我FPGA软核CRC校验防破解思路

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altera的gclks时钟专用管脚能当普通IO使用吗？

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请教LATTICE ecp5 FPGA的SerDes收发异常问题

匿名

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LATTICE xo2-4000的cpld，擦除以后在上电b10的管脚为啥会输出周期的波形

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LATTICE EPC3 DDR3管脚约束给与BANK冲突

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LATTICE ECP3 DDR3 管脚绑定错误

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XILINX FPGA软核MicroBlaze开发资料汇总分享

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FPGA通过MII RGMII接口进行UDP以太网数据通信的教程分享

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警告：.vcd（）：$ scope / $ upscope声明的不平衡或缺失

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请教lattice fpga功能异常，加入reveal debug 后反而正常了

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LATTICE ECP3 FPGA的FASTN引脚是做什么用的，应该怎么连接？

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LATTICE FPGA ECP3-17做4K30时SDI输出有问题

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LATTICE DDR3读写错误问题请教

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lattice Diamond 3.10安装过程中license报错

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怎样读写lattice XO2 CPLD内部的用户FLASH(UFM)？

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LATTICE XO2\XO3系列CPLD的加载时间是多少？

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在FPGA上电后，为什么Active Serial（x1和x4）从Macronix闪存器件配置会发生故障？

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FPGA SDRAM读写测试教程分享

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LATTICE FPGA FrameBuffer与DDR3对接问题请教

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为什么DDR4内存接口信号在示例测试平台仿真的波形中显示‘hxx值？

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请教LATTICE FPGA Diamond 能正常下载程序但是使用reveal功能时，总是连接失败?

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LATTICE ECP5 FPGA触发器异常复位问题请教

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由VCCPT供电时，3V I / O bank上是否支持LVDS I / O标准输入引脚？

匿名

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为什么带有E144封装的Cyclone®10LP的引脚输出文件中缺少DATA4和DATA7配置功能引脚？

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当OSC_CLK_1被选为配置时钟源时，为什么Stratix®10串行闪存邮箱客户端英特尔®FPGAIP核无法正常工作？

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将iopll.ip文件迁移到Quartus Prime Pro 18.0或18.1时是否存在已知问题？

匿名

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哪些是英特尔®Arria10支持的Macronix *闪存器件和英特尔®Quartus®Prime软件版本18.1中的英特尔®Cyclone10 GX？

匿名

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是否有关于Arria 10 PCG中nIO_PULLUP引脚的错误描述？

匿名

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如何使用英特尔®Quartus®Prime编程器更改USB-Blaster的TCK频率？

匿名

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为什么“Sector_Erase”命令在Stratix®10串行闪存邮箱客户端英特尔®FPGAIP核中不起作用？

匿名

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如何在Intel Quartus Prime软件中禁用Hyper Initialization？

匿名

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