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• lattice XO3L实现MIPI DSI 发送，DSI高速模式没有数据输出

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• 谁有LATTICE FPGA 软件 diamond3.9的license文件？

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• 谁能提供下LCMXO2-256HC-4SG32C 与LCMXO2-256ZE-1SG32C这两颗料的规格书及管脚定义，急，谢谢

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• LATTICE FPGA crosslink 和 XO3 的MIPI CSI RX 参考设计在哪里？

● 好回答   × 26

• LATTICE FPGA XO3的feature row 和UFM怎样设置？
• 怎样消除 61061045 WARNING - The SN pin is not available for use as a general purpose I/O pin when the SLAVE_SPI_PORT attribute is enabled.
• lattice DIAMOND报 no clock nets in the design.
• LATTICE FPGA crosslink 和 XO3 的MIPI CSI RX 参考设计在哪里？
• LATTICE FPGA 通过Slave SPI在线升级，怎样可以将JEDEC文件转换成二进制烧录文件？
• LATTICE DIAMOND 报错 Based on the current IO attributes settings, port cannot be assigned to pin
• lattice FPGA 的 ddr generic 这个IP怎么用？
• 谁用LATTICE ECP3做过HDMI的设计？
• LATTICE DIAMOND编译好多警告，MT529,MT246, MT420
• lattice diamond怎样生成NGO？
• LATTCIE ECP3的千兆网DEMO DK-ECP3-TSMAC 为何编译这么慢？
• lattice PLD XO3 的核电压到底是多少？
• 为啥在lattice的官网找不着crosslink的参考设计？
• 请大神帮忙推荐一颗可以替换LCMXO1200C-3FTN256C的芯片。
• 安装diamond出现无法定位输入点FlsAlloc于动态链接库KERNEL32.DLL上
• LATTICE ECP5的全局时钟输入该FPGA有多少对？是否有使用限制要求？
• 请教用FPGA做图像缩放，锯齿该怎么消除？
• LATTICE FPGA 软件DIAMOND中analysis Reports和place&route trace的时序报告哪个为准？
• LATTICE FPGA diamond 从IP Server安装ip后，还是不能用。 还需要怎样的操作吗？
• DDR3 Memory DIMM存储器的 rank指的是什么？
• 对Lattice MIPI DSI TX RD1184参考设计中dcs_rom模块的疑惑
• Lattice ECP3的DDR3存储器控制器到底是哪一个？
• lattice fpga的逻辑分析仪工具有办法reveal 支持 system verilog吗？
• lattice XO3L实现MIPI DSI 发送，DSI高速模式没有数据输出
• lattice diamond默认用synplify ,加入rvl 后是不是用自带综合工具综合的呢？
• 如何用DSP模拟lattice的JTAG下载程序？

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• LATTICE FPGA 通过Slave SPI在线升级，怎样可以将JEDEC文件转换成二进制烧录文件？

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• DDR3 Memory DIMM存储器的 rank指的是什么？
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• MCU模拟JTAG接口对LATTICE CPLD进行在线编程加载

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• lattice的官网好慢啊，谁能发一个diamond3.9 WIN 64版本的软件给我？

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• LATTICE DIAMOND 报错 Based on the current IO attributes settings, port cannot be assigned to pin

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• 请教用FPGA做图像缩放，锯齿该怎么消除？

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• LATTICE FPGA的SERDERS 用作SDI收发时，是否可以使用内部PLL的输出作为时钟？
• DDR3 Memory DIMM存储器的 rank指的是什么？
• 请教大家LATTICE ICE系列FPGA的开发工具iCEcube2 如何使用自带的IP？
• LATTICE ECP3 FPGA的FASTN引脚是做什么用的，应该怎么连接？
• DDR3 存储器的概念 Write leveling 是什么意思？
• ddr3 存储器的 on the fly 是什么意思？

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• Ubuntu 18.04/16.04 安装破解 VCS 2016/2018 和 Verdi 2016/2018，以及和vivado联合仿真
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• FPGA实现基于LUT（查找表）的DDS的设计(含matlab和verilog源码)
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